随着国内集成电路设计产业的发展，越来越多的本地设计公司开始采用目前国际上主流（Mainstream）的物理综合的设计方法。随着半导体工艺的发展和设计复杂度的提升，设计方法也不得不随之改变。在面对0.18微米及以下工艺，100MHz以上主频的设计时，若仍采用传统的综合和布局布线分别考虑，利用线负载模型（Wire-load Model）估计连线延迟的设计方法，前后端的迭代次数明显增加，甚至引起设计的不收敛，造成设计周期的延误，或设计性能的下降。Synopsys自2000年起推出Physical Compiler，并结合其他一系列工具，从设计方法学着手解决时序收敛的问题。目前，Physical Compiler是全球基于0.18微米工艺，100MHz以上频率的主流设计所采用的主要设计工具。

??为了让更多的本地设计工程师熟悉物理综合工具及其设计方法学，特开设本课程。
课程内容如下：